Dados do pedido
Número
PI0707149Tipo
Depósito
Publicação
PCT
US2007060815 Pedido arquivado por falta de pagamento das anuidades (art. 86 da LPI). A tecnologia está em domínio público no Brasil.
Falar com um especialistaÚltima movimentação publicada pelo INPI: 10/03/2020. Atualizamos a cada nova RPI, publicada semanalmente.
Depositantes
Q. I. (pessoa física)
US
Inventores
M. M. (pessoa física)
US
T. S. (pessoa física)
US
Classificação IPC
Prioridades unionistas
US
11/336,282 · 20/01/2006
Resumo técnico
GERENCIAMENTO EFICIENTE DE HIERARQUIA DE MEMÓRIA. Em um processador, existem situações onde instruções e certas partes de um programa podem residir em uma cache de dados antes da execução do programa. Técnicas de hardware e software são providas para buscar uma instrução na cache de dados após ter uma falha em uma cache de instrução para melhorar o desempenho do processador. Se uma instrução não estiver presente na cache de instrução, um endereço de busca de instrução é enviado como um endereço de busca de dados para a cache de dados. Se houver dados válidos presentes na cache de dados no endereço de busca de instrução fornecido, os dados na realidade são uma instrução e a entrada de cache de dados é buscada e fornecida como uma instrução para o complexo de processador. Um bit adicional pode ser incluído em uma tabela de página de instrução para indicar uma falha na cache de instrução e que a cache de dados deve ser verificada para a instrução.
Publicações na Revista da Propriedade Industrial (RPI).
#8.11
Em virtude do arquivamento publicado na RPI 2550 de 19-11-2019 e considerando ausência de manifestação dentro dos prazos legais, informo que cabe ser mantido o arquivamento do pedido de patente, conforme o disposto no artigo 12, da resolução 113/2013.
10/03/2020
RPI 2566
#8.6
Referente à 13ª anuidade.
19/11/2019
RPI 2550
Anulada a publicação código 11.2 na RPI nº 2489 de 18/09/2018 por ter sido indevida.
09/10/2018
RPI 2492
#11.2
Parecer 11.2
18/09/2018
RPI 2489
#6.1
29/05/2018
RPI 2473
#1.3
19/04/2011
RPI 2102
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