Arquivamento definitivo por descumprimento
#8.11
Referente ao despacho 8.6 publicado na RPI 2307 de 24/03/2015.
28/07/2015
RPI 2325
Dados do pedido
Número
PI0409107Tipo
Depósito
Publicação
PCT
US2004010866 Pedido arquivado por falta de pagamento das anuidades (art. 86 da LPI). A tecnologia está em domínio público no Brasil.
Falar com um especialistaÚltima movimentação publicada pelo INPI: 28/07/2015. Atualizamos a cada nova RPI, publicada semanalmente.
Depositantes
Q. I. (pessoa física)
US
Inventores
A. F. (pessoa física)
US
Classificação IPC
Prioridades unionistas
US
10/644,490 · 19/08/2003
US
60/461,889 · 09/04/2003
Resumo técnico
"LOOP TRAVADO POR FASE DIGITAL". Um PLL digital inclui um PFD adaptativo, um filtro de loop adaptativo, um iDAC, um ICO e um divisor. O PFD adaptativo recebe um sinal de referência e um sinal de realimentação, determina erro de fase entre os dois sinais, e provê um valor PFD para cada período de comparação de fase. A magnitude do valor PFD é ajustada para se obter rápida aquisição de freqüência e jitter reduzido. O filtro de loop adaptativo atualiza sua saída sempre que um valor PFD for recebido, amplia a largura de banda de loop PFL se um erro de fase grande for detectado, e estreita a largura de banda de loop se um erro de fase médio pequeno for detectado. O iDAC que pode ser implementado com ambas as fontes de corrente, guiada e de extremidade única, converte a saída de filtro de loop em corrente analógica. O ICO provê um sinal de oscilador tendo uma fase determinada pela saída iDAC. O divisor divide o sinal de oscilador por um fator de N e provê o sinal de realimentação.
Publicações na Revista da Propriedade Industrial (RPI).
#8.11
Referente ao despacho 8.6 publicado na RPI 2307 de 24/03/2015.
28/07/2015
RPI 2325
#8.6
Referente à 11ª anuidade.
24/03/2015
RPI 2307
#1.3
02/05/2006
RPI 1843
Monitoramento de patentes
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