Notificação de entrada na fase nacional - PCT
#1.3
03/09/2024
RPI 2800
Dados do pedido
Número
112024011284Tipo
Depósito
Publicação
PCT
US2022052326 Patente de Invenção (via PCT) depositado no INPI em 08/12/2022. Aguarda exame formal e publicação na RPI.
Última movimentação publicada pelo INPI: 03/09/2024. Atualizamos a cada nova RPI, publicada semanalmente.
Depositantes
VIASAT, INC.
US
Inventores
C. G. (pessoa física)
US
G. K. (pessoa física)
US
Classificação IPC
Prioridades unionistas
US
63/287,509 · 08/12/2021
Resumo técnico
SISTEMA, DECIMADOR DE RETARDO DE TEMPO REAL DE TAXA VARIÁVEL, E, MÉTODO PARA FORNECER FILTRAGEM DE RETARDO DE TEMPO REAL DE TAXA VARIÁVEL. Sistemas, métodos e dispositivos são divulgados para um decimador de retardo de tempo real de taxa variável (VR-TTD) para receber um sinal de dados de entrada e fornecer um sinal decimado de saída. O decimador VR-TTD pode compreender: uma entrada de decimador VR-TTD para receber o sinal de dados de entrada; e uma saída de decimador VR-TTD para emitir o sinal decimado de saída; um oscilador controlado numericamente (NCO) para receber um sinal de controle de retardo de tempo e um sinal de taxa desejada e para controlar filtragem grossa, filtragem fina e decimação do sinal de dados de entrada; e um acumulador para gerar o sinal decimado de saída, em que o acumulador compreende uma pluralidade de registros de deslocamento, controlados pelo NCO. O sistema pode compreender um formador de feixe para fornecer um sinal de saída coerentemente somado a partir de uma pluralidade de caminhos, em que cada caminho compreende um decimador VR-TTD para fornecer VR-TTD aos respectivos sinais da pluralidade de caminhos.
Publicações na Revista da Propriedade Industrial (RPI).
#1.3
03/09/2024
RPI 2800
#1.1
18/06/2024
RPI 2789
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